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Intel presenta l'FPGA Agilex serie M con sottosistema di memoria veloce da record - quasi 1,1 TB/s

Intel presenta l'FPGA Agilex serie M con sottosistema di memoria veloce da record - quasi 1,1 TB/s

Intel ha annunciato i nuovi FPGA Agilex serie M. La lettera "M" nel nome significa Memoria e l'annuncio afferma che i nuovi prodotti hanno un sottosistema di memoria produttivo senza precedenti per un FPGA, che li rende richiesti nel mining di criptovalute e nelle applicazioni di rete, nonché ovunque la larghezza di banda della memoria gioca un ruolo decisivo ruolo.

In effetti, le caratteristiche di questo sottosistema sono impressionanti: i nuovi chip sono dotati di due die HBM2e con un throughput totale di 820 GB/s, che è quasi due terzi in più rispetto al precedente leader in questo settore, lo Stratix 10 MX FPGA. A seconda del modello specifico, il volume della banca di bordo HBM2e può raggiungere i 32 GB. Ma non è tutto: Agilex M ha anche otto canali per la memoria DDR5, che in totale fornisce quasi 1,1 TB/s.

Il bus Memory Network-on-Chip (7,52 TB/s) è responsabile della stretta connessione dei due tipi di RAM. Questi sono i primi FPGA Intel ad essere rilasciati utilizzando la tecnologia di processo Intel 7 (10 nm SuperFin). Inoltre, secondo Intel, questi sono i primi FPGA a supportare cache e coerenza della memoria con i processori Intel Xeon tramite il supporto CXL. Infine, Agilex M è l'unico FPGA in natura in grado di funzionare contemporaneamente con memoria HBM2e, DDR5 e Optane.

I chip comunicano con il mondo esterno tramite interfacce PCI Express 5.0 e 400GbE (transceiver 116G). Intel definisce i suoi nuovi cervelli le migliori soluzioni nel campo dell'elaborazione del segnale digitale e, in termini di prestazioni di interconnessione specifiche (in termini di consumo), sono più del doppio rispetto al loro rivale più vicino, Versal di Xilinx, ora di proprietà di AMD .

Poiché gli FPGA sono universali a priori, è difficile nominare una specifica area di applicazione per i nuovi prodotti, ma date le prestazioni da record dei sottosistemi di memoria e la presenza di 12300 blocchi DSP (18 Tflops FP32, 88.6 Tops INT8), questo può qualsiasi scenario relativo all'elaborazione di flussi di dati seri: DPU/IPU su reti 400G/800G, banchi di prova per reti 5G/6G, radar e altre attività di elaborazione del segnale radio, machine learning e HPC, blockchain e mining di criptovalute.


2022-03-09 10:27:37

Autore: Vitalii Babkin

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