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YMTC が Xtacking 3.0 メモリ アーキテクチャを発表

YMTC が Xtacking 3.0 メモリ アーキテクチャを発表

中国の YMTC は本日、Flash Memory Summit (FMS) 2022 で、革新的な Xtacking 3.0 アーキテクチャに基づく X3-9070 3D NAND フラッシュ メモリを発表しました。新しい中国の 3D NAND チップは、より高い速度と効率を提供できるようになります。

Xtacking アーキテクチャは 2018 年に導入され、その後第 3 世代に進化しました。これは、3D NAND メモリ セルのアレイが 1 つの個別のチップに配置され、電源回路と制御回路が別のチップに配置されていることを前提としています。アレイとコントローラーは、1 つ目と 2 つ目は異なるシリコン ウエハー上で作成されるため、異なる技術プロセスを使用して作成できます。その後、制御チップはメモリセルのアレイと組み合わされ、出力はフル機能の 3D NAND メモリチップです。

セルとコントローラーを別々に生産することで、メモリ結晶の平面上のスペースを節約し (各プレートからより多くのセルを生産する)、一方の生産と他方の生産に縛られることなくセルまたはコントローラーをアップグレードすることができます。現時点では、YMTC がメモリ アレイの製造技術を変更することなく、より生産性の高い 3D NAND をリリースする準備をしている 2 番目のシナリオが実装されています。

ロジックとパワーの改善について話しているので、開発者は、232 のリリースを発表した Micron と SK hynix のように、複数の 3D NAND レイヤーの生産でこれまたはその記録を達成するために 1 行も費やしませんでした。 - および 238- 層状 3D NAND メモリ。代わりに、YMTC は、新しい Xtacking 3.0 対応チップのパフォーマンスがピンあたり最大 2400 MT/s の I/O 速度に達すると報告しました。また、ONFI 5.0 インターフェイスと互換性があり、前世代の製品よりも 50% 優れたパフォーマンスを達成すると主張しています。

さらに、X3-9070 は YMTC 史上最高密度のフラッシュ製品であり、超コンパクトなモノブロックで 1 TB のストレージ容量を提供します。以前は 4 プレーン構成がサポートされていましたが、新しいコントローラーは 6 プレーン フラッシュ セル構成をサポートするようになりました。独立した処理のための 6 つのセル領域のサポートにより、並列操作を拡張し、メモリ パフォーマンスを向上させることができます。特に、消費を最大 25% 削減しながら、生産性を最大 50% 向上させることが約束されています。

さらに、同社は、新しいアーキテクチャが製品にいつ登場するかを特定していません。


2022-08-03 12:36:08

著者: Vitalii Babkin

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