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IntelがAlderLakeプロセッサのアーキテクチャを明らかにし、それらがどのように機能するかを説明します

IntelがAlderLakeプロセッサのアーキテクチャを明らかにし、それらがどのように機能するかを説明します

詳細は、この秋に予定されているAlderLakeプロセッサのアーキテクチャに関する特別なIntelArchitectureDayイベントで本日発表されました。これらはハイブリッドアーキテクチャの最初の大衆キャリアであり、Intel ThreadDirectorテクノロジーによってインテリジェントに配布される異種コアGracemontとGoldenCoveに基づいています。古いバージョンのAlderLakeは、最大16コアと最大24スレッドを受け取り、DDR5メモリとPCI Express5.0バスをサポートします。

発表された情報によると、デスクトップAlder Lakeプロセッサは、8つの生産的なGolden Coveコアと、エネルギー効率の高いGracemontコアを備えた2つのクアッドコアクラスターを自由に使用できます。したがって、古いデスクトップバージョンのAlder Lakeには16コアがあり、ハイパースレッディングテクノロジーはGolden Coveコアでのみサポートされているため、合計で24スレッドを実行できます。また、16コアのAlder Lakeプロセッサには、負荷に応じて動的に変化する包括性ポリシーを備えた30MBの第3レベルのキャッシュメモリが追加されます。

Intelは、運用中のAlder Lakeの異種コアの負荷を管理するために、特別なThreadDirectorテクノロジーを実装しました。このハードウェアソリューションは、すべてのコアの状態とそれらが実行する命令に関するリアルタイムのテレメトリデータを収集し、さまざまなタイプのコア間でスレッドを移動する可能性に関する情報をOSスケジューラに送信します。 Thread Directorは動的で適応性のあるテクノロジーであるため、その効率は、同様のルールベースのアルゴリズムよりも明らかに高くなっています。

スレッドディレクターのタスクは、実行速度にとって重要なリソースを大量に消費するスレッドと、ベクターコマンドを使用するスレッドを生産的なコアにタイムリーに移動することです。同時に、CPUの応答性に要件を課さないバックグラウンドスレッドまたはタスクは、エネルギー効率の高いコアに移植されます。これに加えて、IntelはPowerThrottling APIライブラリの拡張機能を準備しています。これにより、ソフトウェア開発者はスレッドの優先度を手動で指定し、エネルギー効率の高いコアにリダイレクトする可能性を示すことができます。

Thread DirectorはハードウェアのCPUに組み込まれていますが、OSからのサポートが必要です。 Intelは現在、スケジューラがAlderLakeハイブリッドアーキテクチャに精通しているWindows11でのそのようなサポートについて話し合っています。 Thread Directorをサポートしていない他のオペレーティングシステムでは、Alder Lakeのパフォーマンスが低下する可能性がありますが、Intelはすべての主要なOS開発者と協力していると述べています。さらに、Windows 10では、ハイブリッドプロセッサの正しい機能に問題はありません。このOSの負荷分散は、Intelハードウェアガイド付きスケジューリング(HGS)メカニズムによって提供されます。

Alder Lakeデスクトッププロセッサには、LGA 1700ソケットを備えた新しいマザーボードが必要になります。この場合、これは、新しいタイプのメモリと外部インターフェイスのサポートが登場したためです。 DDR4-3200に加えて、デスクトップAlder Lakeは、DDR5-4800までの新しいDDR5メモリと互換性があります。同時に、プロセッサに組み込まれたPCIeコントローラは、PCで初めてグラフィックカードを接続するための16個のPCIe 5.0レーンと、ソリッドステートドライブ用の追加の4個のPCIe4.0レーンをサポートします。 PCIe5.0はPCIe4.0の2倍の帯域幅を提供することを思い出してください。

さらに、デスクトップAlder Lakeプロセッサは、Xe-LPアーキテクチャに基づく統合グラフィックコアを提供し、32の実行ユニットを使用して構築されています(Rocket Lakeの場合と同様)。

Alder Lakeプロセッサの構造内の機能ブロックは、最大1 TB / sの合計帯域幅を持つ新しい内部バスによってリンクされています。このバスは、コアまたはクラスターごとに100 GB / sの帯域幅を提供し、L3キャッシュを介した高速コア間通信を提供します。動的な周波数制御に加えて、遅延の削減を優先する柔軟なルーティングを提供します。

デスクトップのAlderLakeプロセッサに加えて、Intelは、これらのチップのモバイルBGA修正を、わずかに異なる構造単位のセットと低消費電力でリリースすることを約束しました。一般的なモバイル構成には、6つのGoldenCoveコアと8つのGracemontコアがあります。このバージョンのXe-LPグラフィックコアには96台のエグゼクティブデバイスがあり、L3キャッシュボリュームは24MBになります。ウルトラモバイルバージョンでは、生産性の高いゴールデンコーブコアの数がさらに2つに減り、L3キャッシュのボリュームが12MBに減ります。

Alder Lakeモバイルバージョンは、DDR4-3200およびDDR5-4800に加えて、エネルギー効率の高いLPDDR4x-4266およびLPDDR5-5200メモリのサポートを受け、ストリーミングビデオを処理するための統合されたThunderbolt4コントローラーとIPUコプロセッサーも備えています。

Alder Lakeプロセッサは、Intel 7プロセステクノロジ(以前の10 nm Enhanced SuperFin)を使用して製造され、Intelによれば、最も生産性が高くなります。


2021-08-19 14:50:47

著者: Vitalii Babkin

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